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在电路设计应用的时候，往往需要暂时储存大量的资料以供电路运算，现在FPGA都有提供内部记忆体区块，来让使用者储存资料，使用方式则是透过FPGA 的软体工具(Quartus)来产生记忆体区块的模组程式码(Verilog/VHDL)，使用者将此模组与电路的其他模组相接即可。实际上，FPGA 软体工具在将使用者的电路做合成时，即会将记忆体模组实际对映到FPGA 内部的记忆体区块上，故使用者的电路就可以读写FPGA 内部的记忆体区块。